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为了在高速图像处理平台特定的网络结构中实现两片DSP与PHY芯片通过一个管理数据输入输出接口(Management Data Input/Output,MDIO)进行通信,利用VHDL语言实现了一个总线切换功能,并设计了一个MDIO总线信号捕获状态机,用该态机的输出来作为双向端口的控制信号,实现了MDIO总线信号在FPGA上实时透明双向传输和两条MDIO总线的实时切换。配合TI公司的网络开发套件,保证了平台正常的网络运行。 相似文献
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提出一种用于汽车防撞系统的快速视频图像采集系统.利用PHILIPS公司的视频处理芯片SAA7111A作为图像采集芯片,在单片机和CPLD的控制下将采集到的图像数据写入帧存储器中供后续DSP对视频数据进行分析处理;针对汽车防撞系统对实时性的要求,帧存储器的设计采用两级级联的形式,达到了采集和数据处理的并行运行. 相似文献
13.
基于FPGA自行设计了JPEG图像压缩编码芯片,通过改进算法,优化结构,在合理利用硬件资源的条件下,有效挖掘出算法内部的并行性。设计了专用的CSD乘法器,精简的DCT运算电路单元,以及查找表的编码方式,提高了运算速度节省了芯片的逻辑资源。整个设计通过EDA软件进行了逻辑综合及功能与时序仿真。综合和仿真结果表明：该设计在速度和资源利用方面均达到了较好的状态,可满足实时JPEG图像压缩的要求。 相似文献