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周立 《地球科学与环境学报》1998,(Z1)
本文提供一种用PLD器件设计任意地址范围译码器的简便方法。该方法给出了利用地址区间边界值直接写出地址译码逻辑式的三个设计规则和为进一步简化设计过程的两个补充设计规则。本设计方法对于用FM软件进行PLD器件开发非常方便和实用。 相似文献
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由于差错控制在超宽带室内导航系统中占据着十分重要的位置,并考虑到IEEE802.15.3a标准采用卷积编码和Viterbi译码来进行差错控制,因此利用现场可编程门阵列(FPGA)设计实现了一种约束长度为7,译码深度为64的全并行Viterbi译码器。本设计在xilinx ISE9.2环境下进行了综合,并采用Modelsim6.0对整个设计进行了仿真。仿真结果表明,该设计能够满足超宽带系统的要求。 相似文献
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